{"id":112716,"date":"2018-03-11T10:39:48","date_gmt":"2018-03-11T10:39:48","guid":{"rendered":"https:\/\/www.deberes.net\/tesis\/sin-categoria\/architectural-explorations-for-streaming-accelerators-with-customized-memory-layouts\/"},"modified":"2018-03-11T10:39:48","modified_gmt":"2018-03-11T10:39:48","slug":"architectural-explorations-for-streaming-accelerators-with-customized-memory-layouts","status":"publish","type":"post","link":"https:\/\/www.deberes.net\/tesis\/diseno-y-componentes-de-sistemas-de-informacion\/architectural-explorations-for-streaming-accelerators-with-customized-memory-layouts\/","title":{"rendered":"Architectural explorations for streaming accelerators with customized memory layouts"},"content":{"rendered":"<h2>Tesis doctoral de <strong> Muhammad Shafiq <\/strong><\/h2>\n<p>El concepto b\u00e1sico de la arquitectura mono-nucleo en los procesadores de prop\u00f3sito general se ajusta bien a un modelo de programaci\u00f3n secuencial. La integraci\u00f3n de multiples n\u00facleos en un solo chip ha permitido a los procesadores correr partes del programa en paralelo. Sin embargo, la explotaci\u00f3n del enorme paralelismo disponible en muchas aplicaciones de alto  rendimiento y de los datos correspondientes es dif\u00edcil de conseguir usando unicamente multicores de prop\u00f3sito general. La aparici\u00f3n de aceleradores tipo streaming y de los correspondientes modelos de programaci\u00f3n han mejorado esta situaci\u00f3n proporcionando arquitecturas orientadas al proceso de flujos de datos. La idea b\u00e1sica detr\u00e1s del dise\u00f1o de estas arquitecturas responde a la necesidad de procesar conjuntos enormes de datos. Estos dispositivos de alto rendimiento orientados a flujos permiten el procesamiento rapido de datos mediante el uso eficiente de computaci\u00f3n paralela y comunicaci\u00f3n entre procesos.  los aceleradores streaming orientados a flujos, igual que en otros procesadores, consisten en diversos componentes micro-arquitectonicos como por ejemplo las estructuras de memoria, las unidades de computo, las unidades de control, los canales de entrada\/salida y controles de entrada\/salida, etc. Sin embargo, los  requisitos del flujo de datos agregan algunas caracter\u00edsticas especiales e imponen otras restricciones que afectan al rendimiento. Estos dispositivos, por lo general, ofrecen un gran n\u00famero de recursos computacionales, pero obligan a  reorganizar los conjuntos de datos en paralelo, maximizando la independiencia para alimentar los recursos de computaci\u00f3n en forma de flujos.   la disposici\u00f3n de datos en conjuntos independientes de flujos paralelos no es una tarea sencilla. Es posible que se tenga que cambiar la estructura de un algoritmo en su conjunto o, incluso,  puede requerir la reescritura del algoritmo desde cero. Sin embargo, todos estos esfuerzos para la reordenaci\u00f3n de los patrones de las aplicaciones de acceso a datos puede que no sean muy \u00fatiles para lograr un rendimiento \u00f3ptimo. Esto es debido a las posibles limitaciones microarquitectonicas de la plataforma de destino para los mecanismos hardware de prefetch, el tama\u00f1o y la granularidad del almacenamiento local, y la flexibilidad para disponer de forma serial los datos en el interior del almacenamiento local. Las limitaciones de una plataforma de streaming de proposito general para el prefetching de datos, almacenamiento y demas procedimientos para organizar y mantener los datos en forma de flujos paralelos e independientes podr\u00eda ser eliminado empleando t\u00e9cnicas a nivel micro-arquitectonico. Esto incluye el uso de  memorias personalizadas especificamente para las aplicaciones en el front-end de una arquitectura streaming.  el objetivo de esta tesis es presentar exploraciones arquitect\u00f3nicas de los aceleradores streaming con dise\u00f1os de memoria personalizados. En general, la tesis cubre tres aspectos principales de tales aceleradores. Estos aspectos se pueden clasificar como: i) dise\u00f1o de aceleradores de aplicaciones espec\u00edficas con dise\u00f1os de memoria personalizados, ii) dise\u00f1o de aceleradores con memorias personalizadas basados en plantillas, y iii) exploraciones del espacio de dise\u00f1o para dispositivos orientados a flujos con las memorias est\u00e1ndar y personalizadas.   esta tesis concluye con la propuesta conceptual de una blacksmith streaming architecture (bsarc). El modelo de computaci\u00f3n blacksmith permite la adopci\u00f3n a nivel de hardware de un front-end de aplicaci\u00f3n espec\u00edfico utilizando una gpu como back-end. Esto permite maximizar la explotaci\u00f3n de la localidad de datos y el paralelismo a nivel de datos de una aplicaci\u00f3n mientras que proporciona un flujo mayor de datos al back-end. Consideramos que el dise\u00f1o de estos procesadores con memorias especializadas debe ser proporcionado por expertos del dominio de aplicaci\u00f3n en la forma de plantillas.<\/p>\n<p>&nbsp;<\/p>\n<h3>Datos acad\u00e9micos de la tesis doctoral \u00ab<strong>Architectural explorations for streaming accelerators with customized memory layouts<\/strong>\u00ab<\/h3>\n<ul>\n<li><strong>T\u00edtulo de la tesis:<\/strong>\u00a0 Architectural explorations for streaming accelerators with customized memory layouts <\/li>\n<li><strong>Autor:<\/strong>\u00a0 Muhammad Shafiq <\/li>\n<li><strong>Universidad:<\/strong>\u00a0 Polit\u00e9cnica de catalunya<\/li>\n<li><strong>Fecha de lectura de la tesis:<\/strong>\u00a0 21\/05\/2012<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n<h3>Direcci\u00f3n y tribunal<\/h3>\n<ul>\n<li><strong>Director de la tesis<\/strong>\n<ul>\n<li>Eduard Ayguad\u00e9 Parra<\/li>\n<\/ul>\n<\/li>\n<li><strong>Tribunal<\/strong>\n<ul>\n<li>Presidente del tribunal: georgi Nedeltchev gaydadjiev <\/li>\n<li>osman Unsal Garc\u00eda (vocal)<\/li>\n<li>  (vocal)<\/li>\n<li>  (vocal)<\/li>\n<\/ul>\n<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n","protected":false},"excerpt":{"rendered":"<p>Tesis doctoral de Muhammad Shafiq El concepto b\u00e1sico de la arquitectura mono-nucleo en los procesadores de prop\u00f3sito general se ajusta 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