{"id":114025,"date":"2013-05-04T00:00:00","date_gmt":"2013-05-04T00:00:00","guid":{"rendered":"https:\/\/www.deberes.net\/tesis\/sin-categoria\/automatic-synthesis-and-optimization-of-chip-multiprocessors\/"},"modified":"2013-05-04T00:00:00","modified_gmt":"2013-05-04T00:00:00","slug":"automatic-synthesis-and-optimization-of-chip-multiprocessors","status":"publish","type":"post","link":"https:\/\/www.deberes.net\/tesis\/arquitectura-de-ordenadores\/automatic-synthesis-and-optimization-of-chip-multiprocessors\/","title":{"rendered":"Automatic synthesis and optimization of chip multiprocessors"},"content":{"rendered":"

Tesis doctoral de Nikita Nikitin <\/strong><\/h2>\n

Nikitinla tecnolog\u00eda de microprocesadores ha experimentado un crecimiento importante durante las \u00faltimas d\u00e9cadas. La r\u00e1pida miniaturizaci\u00f3n de la tecnolog\u00eda cmos ha causado un incremento de las frecuencias de operaci\u00f3n y del rendimiento por unidad de \u00e1rea, enfrent\u00e1ndose al problema fundamental de disipaci\u00f3n de energ\u00eda. Los multiprocesadores en chip (cmps) se han convertido en el \u00faltimo paradigma para mejorar la eficiencia de consumo y rendimiento de los sistemas de computaci\u00f3n, aprovechando el paralelismo inherente en las aplicaciones. Los prototipos y las implementaciones industriales han demostrado los beneficios obtenidos por los cmps con cientos de n\u00facleos.Los dise\u00f1adores de cmps se enfrentan a numerosas y complicadas decisiones. Algunas de ellas son: – \u00c2\u00bfcu\u00e1l deber\u00eda ser el ratio entre el \u00e1rea de los n\u00facleos y el \u00e1rea de la memoria en un chip? – \u00c2\u00bfqu\u00e9 arquitectura de n\u00facleo se deber\u00eda seleccionar? – \u00c2\u00bfcu\u00e1ntos niveles de jerarqu\u00eda deber\u00eda tener el subsistema de memoria? – \u00c2\u00bfqu\u00e9 topolog\u00edas de interconexi\u00f3n proporcionan una comunicaci\u00f3n eficiente en chip? \u00e9stos y muchos otros aspectos crean un espacio complejo multidimensional para la exploraci\u00f3n de la arquitectura. Las herramientas para la automatizaci\u00f3n del dise\u00f1o empiezan a ser esenciales para hacer factible la exploraci\u00f3n de arquitectura, dadas las restricciones del tiempo de comercializaci\u00f3n. Los m\u00e9todos de exploraci\u00f3n deben ser eficientes y escalables para aplicarse a las futuras arquitecturas en chip con cientos o miles de n\u00facleos.Una vez fabricados, los cmps necesitan estrategias para la maximizar su rendimiento. Se necesitan m\u00e9todos inteligentes para la asignaci\u00f3n y planificaci\u00f3n de tareas para garantizar el uso total de los beneficios de los procesadores con muchos n\u00facleos. Estos m\u00e9todos deben tener en cuenta las particularidades de las arquitecturas modernas, como las t\u00e9cnicas avanzadas para ahorro de consumo y las jerarqu\u00edas complejas de memoria. esta tesis tiene distintos objetivos. El primero es proponer m\u00e9todos para el modelado anal\u00edtico eficiente y la exploraci\u00f3n de la arquitectura de cmps. La eficiencia se consigue mediante el uso de modelos anal\u00edticos en lugar de simulaciones, y la sustituci\u00f3n de la exploraci\u00f3n exhaustiva con una estrategia de b\u00fasqueda inteligente. Adem\u00e1s, estos m\u00e9todos incorporan modelos de alto nivel para la planificaci\u00f3n f\u00edsica. Las contribuciones relacionadas est\u00e1n descritas en los cap\u00edtulos 3, 4 y 5 del documento.El segundo objetivo de este trabajo es proponer un algoritmo escalable para la asignaci\u00f3n de tareas para los cmps de prop\u00f3sito general con t\u00e9cnicas de control de consumo, para la utilizaci\u00f3n eficiente de los sistemas de muchos n\u00facleos. Esta contribuci\u00f3n se detalla en el cap\u00edtulo 6 de la tesis.Finalmente, el tercer objetivo de esta tesis es considerar los aspectos del dise\u00f1o y la exploraci\u00f3n de las interconexiones en chip, y desarrollar un modelo para optimizar conjuntamente el encaminamiento de mensajes y la asignaci\u00f3n de canales en las redes de inteconexi\u00f3n. la metodolog\u00eda desarrollada puede ser aplicada a varias clases de sistemas en chip, desde los procesadores de prop\u00f3sito general hasta los sistemas para aplicaciones espec\u00edficas. El cap\u00edtulo 7 describe el modelo propuesto.Los m\u00e9todos presentados han sido comprobados met\u00f3dicamente mediante experimentos, cuyos resultados est\u00e1n descritos en esta tesis. Al final del documento se proponen unas posibles direcciones para trabajo futuro.<\/p>\n

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Datos acad\u00e9micos de la tesis doctoral \u00abAutomatic synthesis and optimization of chip multiprocessors<\/strong>\u00ab<\/h3>\n
    \n
  • T\u00edtulo de la tesis:<\/strong>\u00a0 Automatic synthesis and optimization of chip multiprocessors <\/li>\n
  • Autor:<\/strong>\u00a0 Nikita Nikitin <\/li>\n
  • Universidad:<\/strong>\u00a0 Polit\u00e9cnica de catalunya<\/li>\n
  • Fecha de lectura de la tesis:<\/strong>\u00a0 05\/04\/2013<\/li>\n<\/ul>\n

     <\/p>\n

    Direcci\u00f3n y tribunal<\/h3>\n
      \n
    • Director de la tesis<\/strong>\n
        \n
      • Jordi Cortadella Fortuny<\/li>\n<\/ul>\n<\/li>\n
      • Tribunal<\/strong>\n
          \n
        • Presidente del tribunal: jose Duato marin <\/li>\n
        • giorgos Dimitrakopoulos (vocal)<\/li>\n
        • Jos\u00e9 Flich cardo (vocal)<\/li>\n
        • Antonio Juan hormigo (vocal)<\/li>\n<\/ul>\n<\/li>\n<\/ul>\n

           <\/p>\n","protected":false},"excerpt":{"rendered":"

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