{"id":132519,"date":"1996-01-01T00:00:00","date_gmt":"1996-01-01T00:00:00","guid":{"rendered":"https:\/\/www.deberes.net\/tesis\/sin-categoria\/aportaciones-a-la-sintesis-logica-a-nivel-transistor-de-sistemas-v-l-s-i\/"},"modified":"1996-01-01T00:00:00","modified_gmt":"1996-01-01T00:00:00","slug":"aportaciones-a-la-sintesis-logica-a-nivel-transistor-de-sistemas-v-l-s-i","status":"publish","type":"post","link":"https:\/\/www.deberes.net\/tesis\/ciencias-tecnologicas\/aportaciones-a-la-sintesis-logica-a-nivel-transistor-de-sistemas-v-l-s-i\/","title":{"rendered":"Aportaciones a la sintesis logica a nivel transistor de sistemas v.l.s.i."},"content":{"rendered":"<h2>Tesis doctoral de <strong> Josep Mar\u00eda Garrell Guiu <\/strong><\/h2>\n<p>La sintesis logica es el nombre que recibe el proceso a traves del cual se dise\u00f1a un circuito electronico a partir de un conjunto de ecuaciones que describen su funcionamiento. Este proceso ha venido haciendose historicamente utilizando como unidad minima de dise\u00f1o la puerta logica. Estas puertas logicas, por su parte, estan construidas a partir de transistores. En este trabajo presento un nuevo metodo por el cual se puede realizar la sintesis logica directamente a nivel transistor. Esto hace que la complejidad de la sintesis aumente notablemente, aunque se espera que haya alguna mejoria sobre el circuito sintetizado. La mejora sobre la que me he focalizado, ha sido la construccion de circuitos que minimizan el numero de transistores necesarios para su sintesis. El trabajo ha tenido que integrar tecnolog\u00edas de tres areas diferentes: la sintesis logica (dise\u00f1o microelectronico), tecnicas de inteligencia artificial y tecnicas de paralelismo. El nuevo proceso de sintesis trabaja de la forma siguiente. A partir de la funcion logica que se desee implementar, se construye una estructura de datos que la representa. La estructura escogida, que durante diversos a\u00f1os se ha utilizado ampliamente en trabajos de verificacion de circuitos, recibe el nombre de robdd (reduced ordered binary decision diagram). A partir del robdd construido, se establece un proceso de asociacion fisica que transforma esta estructura de datos en circuito electronico. Como que el objetivo deseado es la construccion de circuitos que sean optimos en cuanto al numero de transistores utilizados, ha sido preciso aplicar alguna tecnica que, asociada a los robdd intentase minimizar este factor. El problema que tratamos es modelable como el problema del viajante de comercio (tsp) y, por tanto, hemos podido aplicar algunas de las tecnicas que solucionan esta clase de problemas. Hemos estado aplicando redes neuronales, algoritmos geneticos y simulated annealing. Como la co<\/p>\n<p>&nbsp;<\/p>\n<h3>Datos acad\u00e9micos de la tesis doctoral \u00ab<strong>Aportaciones a la sintesis logica a nivel transistor de sistemas v.l.s.i.<\/strong>\u00ab<\/h3>\n<ul>\n<li><strong>T\u00edtulo de la tesis:<\/strong>\u00a0 Aportaciones a la sintesis logica a nivel transistor de sistemas v.l.s.i. <\/li>\n<li><strong>Autor:<\/strong>\u00a0 Josep Mar\u00eda Garrell Guiu <\/li>\n<li><strong>Universidad:<\/strong>\u00a0 Ram\u00f3n llull<\/li>\n<li><strong>Fecha de lectura de la tesis:<\/strong>\u00a0 01\/01\/1996<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n<h3>Direcci\u00f3n y tribunal<\/h3>\n<ul>\n<li><strong>Director de la tesis<\/strong>\n<ul>\n<li>Miquel Bertran  Salvans<\/li>\n<\/ul>\n<\/li>\n<li><strong>Tribunal<\/strong>\n<ul>\n<li>Presidente del tribunal: Josep Mart\u00ed Roca <\/li>\n<li>Teodor Jove (vocal)<\/li>\n<li>Carlos Gonzalez (vocal)<\/li>\n<li>Antoni Trias (vocal)<\/li>\n<\/ul>\n<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n","protected":false},"excerpt":{"rendered":"<p>Tesis doctoral de Josep Mar\u00eda Garrell Guiu La sintesis logica es el nombre que recibe el proceso a traves del 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