{"id":132521,"date":"1996-01-01T00:00:00","date_gmt":"1996-01-01T00:00:00","guid":{"rendered":"https:\/\/www.deberes.net\/tesis\/sin-categoria\/mecanismos-de-planificacion-dinamica-de-flujos-de-instrucciones-para-la-mejora-del-rendimiento-de-arquitecturas-superescalares-multiflujo\/"},"modified":"1996-01-01T00:00:00","modified_gmt":"1996-01-01T00:00:00","slug":"mecanismos-de-planificacion-dinamica-de-flujos-de-instrucciones-para-la-mejora-del-rendimiento-de-arquitecturas-superescalares-multiflujo","status":"publish","type":"post","link":"https:\/\/www.deberes.net\/tesis\/ciencias-tecnologicas\/mecanismos-de-planificacion-dinamica-de-flujos-de-instrucciones-para-la-mejora-del-rendimiento-de-arquitecturas-superescalares-multiflujo\/","title":{"rendered":"Mecanismos de planificacion dinamica de flujos de instrucciones para la mejora del rendimiento de arquitecturas superescalares multiflujo."},"content":{"rendered":"<h2>Tesis doctoral de <strong> Miquel Nicolau Vila <\/strong><\/h2>\n<p>En este trabajo se proponen una serie de algoritmos que pretenden mejorar el rendimiento de las arquitecturas superescalares. Estos algoritmos superescalares multiflujo permiten ejecutar en paralelo multiples flujos de instrucciones sobre un unico procesador. Estas arquitecturas han sido propuestas para poder explorar todo el paralelismo que pueden soportar las arquitecturas superescalares actuales. El bajo paralelismo extraible de los flujos de instrucciones hace que dificilmente, se puedan ejecutar, de media, mas de dos instrucciones en paralelo. Las dependencias de datos y de control restringen considerablemente la ejecucion paralela de programas. Gracias a la incorporacion de flujos independientes sobre un mismo procesador, el grado de paralelismo extraible sera muy superior. Al ejecutar multiples flujos de instrucciones, es necesario implementar algun tipo de mecanismo que permita escoger, en cada ciclo de fletch, el flujo o flujos de donde leer las nuevas instrucciones. Estos mecanismos estaran guiados por los algoritmos de planificacion dinamica de flujos de instrucciones. Precisamente, el objetivo de este trabajo sera el estudio de este tipo de algoritmos, con el fin de obtener el mejor rendimiento de las arquitecturas superescalares multiflujo.<\/p>\n<p>&nbsp;<\/p>\n<h3>Datos acad\u00e9micos de la tesis doctoral \u00ab<strong>Mecanismos de planificacion dinamica de flujos de instrucciones para la mejora del rendimiento de arquitecturas superescalares multiflujo.<\/strong>\u00ab<\/h3>\n<ul>\n<li><strong>T\u00edtulo de la tesis:<\/strong>\u00a0 Mecanismos de planificacion dinamica de flujos de instrucciones para la mejora del rendimiento de arquitecturas superescalares multiflujo. <\/li>\n<li><strong>Autor:<\/strong>\u00a0 Miquel Nicolau Vila <\/li>\n<li><strong>Universidad:<\/strong>\u00a0 Ram\u00f3n llull<\/li>\n<li><strong>Fecha de lectura de la tesis:<\/strong>\u00a0 01\/01\/1996<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n<h3>Direcci\u00f3n y tribunal<\/h3>\n<ul>\n<li><strong>Director de la tesis<\/strong>\n<ul>\n<li>Teodor Jove Lagunas<\/li>\n<\/ul>\n<\/li>\n<li><strong>Tribunal<\/strong>\n<ul>\n<li>Presidente del tribunal: Daniel Cabedo Puy <\/li>\n<li>Jos\u00e9 Mar\u00eda Llaberia Gri\u00f1\u00f3 (vocal)<\/li>\n<li>Jean Xavier Rampon (vocal)<\/li>\n<li>Victor Vi\u00f1als Yufera (vocal)<\/li>\n<\/ul>\n<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n","protected":false},"excerpt":{"rendered":"<p>Tesis doctoral de Miquel Nicolau Vila En este trabajo se proponen una serie de algoritmos que pretenden mejorar el rendimiento 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