{"id":77829,"date":"2018-03-09T23:23:25","date_gmt":"2018-03-09T23:23:25","guid":{"rendered":"https:\/\/www.deberes.net\/tesis\/sin-categoria\/energy-efficient-hardware-software-co-design-for-dynamically-reconfigurable-architectures\/"},"modified":"2018-03-09T23:23:25","modified_gmt":"2018-03-09T23:23:25","slug":"energy-efficient-hardware-software-co-design-for-dynamically-reconfigurable-architectures","status":"publish","type":"post","link":"https:\/\/www.deberes.net\/tesis\/tecnologia-de-los-ordenadores\/energy-efficient-hardware-software-co-design-for-dynamically-reconfigurable-architectures\/","title":{"rendered":"Energy-efficient hardware\/software co-design for dynamically reconfigurable architectures"},"content":{"rendered":"<h2>Tesis doctoral de <strong> Juan  Jos\u00e9 Noguera Serra <\/strong><\/h2>\n<p>La computaci\u00f3n reconfigurable es una alternativa interesante a la hora de implementar sistemas embebidos, dado que proporciona el alto rendimiento de las arquitecturas hardware de prop\u00f3sito espec\u00edfico y la flexibilidad de los micro-procesadores est\u00e1ndar.  el trabajo de investigaci\u00f3n llevado a cabo en esta tesis, se dirige a sistemas embebidos port\u00e1tiles, que sean capaces de ejecutar varias aplicaciones al mismo tiempo (por ejemplo, un tel\u00e9fono m\u00f3vil capaz de ejecutar un decodificador mp3, hacer una foto y posteriormente, mejorar la calidad de la imagen). En estos tipos de sistemas, la ejecuci\u00f3n de las aplicaciones no es determinista dado el alto nivel de interacci\u00f3n del usuario, y por lo tanto requiere de una planificaci\u00f3n din\u00e1mica.   este trabajo propone la implementaci\u00f3n de este tipo de aplicaciones sobre arquitecturas din\u00e1micamente reconfigurables. En este sentido, esta tesis presenta diferentes t\u00e9cnicas, tanto a nivel de arquitectura como a nivel de compilaci\u00f3n, para mejorar el rendimiento y reducir el consumo de energ\u00eda.  en el nivel de arquitectura, se propone una arquitectura multi-procesador din\u00e1micamente reconfigurable. En ella podemos encontrar dos bloques clave: (1) un sub-sistema de memoria l2 que incluye diferentes unidades para el pre-fetch de datos y de los contextos para las reconfiguraciones; y (2) una unidad de planificaci\u00f3n din\u00e1mica basada en hardware. Para minimizar el consumo din\u00e1mico de potencia, se propone una arquitectura reconfigurable con m\u00faltiples dominios de reloj, donde se puede parar el reloj o utilizar t\u00e9cnicas de escalado de frecuencia. La unidad de planificaci\u00f3n din\u00e1mica, basada en una implementaci\u00f3n hardware (diferente de los trabajos previos basados en t\u00e9cnicas de planificaci\u00f3n est\u00e1tica o el uso de un sistema operativo), se encarga de planificar la ejecuci\u00f3n de tareas y las reconfiguraciones. Para minimizar el overhead de reconfiguraci\u00f3n, el planificador de tareas (ejecuci\u00f3n) usa el concepto de re-uso de contexto, y el planificador de reconfiguraciones utiliza el concepto de pre-fetch de configuraciones. Adem\u00e1s, la unidad de planificaci\u00f3n din\u00e1mica resuelve, autom\u00e1ticamente y en tiempo de ejecuci\u00f3n, las dependencias de datos entre tareas de una misma aplicaci\u00f3n.  finalmente, en esta tesis se han desarrollado un conjunto de t\u00e9cnicas de dise\u00f1o a nivel de sistema para mejorar el rendimiento y reducir el consumo de energ\u00eda. Este conjunto de t\u00e9cnicas deben considerarse como parte de un posible compilador encargado de implementar una aplicaci\u00f3n sobre la arquitectura reconfigurable. En este trabajo se proponen tres t\u00e9cnicas principales: (1) un algoritmo de particionado hw\/sw que considera el pre-fetch de configuraciones; (2) una t\u00e9cnica de particionado de datos consciente del tiempo de reconfiguraci\u00f3n, que hace posible estudiar los diferentes compromisos en t\u00e9rminos de energ\u00eda y rendimiento; y (3) diferentes t\u00e9cnicas de transformaci\u00f3n del grafo para aumentar el paralelismo a nivel de tarea.<\/p>\n<p>&nbsp;<\/p>\n<h3>Datos acad\u00e9micos de la tesis doctoral \u00ab<strong>Energy-efficient hardware\/software co-design for dynamically reconfigurable architectures<\/strong>\u00ab<\/h3>\n<ul>\n<li><strong>T\u00edtulo de la tesis:<\/strong>\u00a0 Energy-efficient hardware\/software co-design for dynamically reconfigurable architectures <\/li>\n<li><strong>Autor:<\/strong>\u00a0 Juan  Jos\u00e9 Noguera Serra <\/li>\n<li><strong>Universidad:<\/strong>\u00a0 Polit\u00e9cnica de catalunya<\/li>\n<li><strong>Fecha de lectura de la tesis:<\/strong>\u00a0 16\/12\/2005<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n<h3>Direcci\u00f3n y tribunal<\/h3>\n<ul>\n<li><strong>Director de la tesis<\/strong>\n<ul>\n<li>Rosa Mar\u00eda Badia Sala<\/li>\n<\/ul>\n<\/li>\n<li><strong>Tribunal<\/strong>\n<ul>\n<li>Presidente del tribunal: rom\u00e1n Hermida correa <\/li>\n<li>eduard Ayguad\u00e9 parra (vocal)<\/li>\n<li>  (vocal)<\/li>\n<li>  (vocal)<\/li>\n<\/ul>\n<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n","protected":false},"excerpt":{"rendered":"<p>Tesis doctoral de Juan Jos\u00e9 Noguera Serra La computaci\u00f3n reconfigurable es una alternativa interesante a la hora de implementar sistemas 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