{"id":98453,"date":"2018-03-11T10:19:17","date_gmt":"2018-03-11T10:19:17","guid":{"rendered":"https:\/\/www.deberes.net\/tesis\/sin-categoria\/alternativas-de-diseno-en-sistemas-de-prebusqueda-hardware-de-datos\/"},"modified":"2018-03-11T10:19:17","modified_gmt":"2018-03-11T10:19:17","slug":"alternativas-de-diseno-en-sistemas-de-prebusqueda-hardware-de-datos","status":"publish","type":"post","link":"https:\/\/www.deberes.net\/tesis\/arquitectura-de-ordenadores\/alternativas-de-diseno-en-sistemas-de-prebusqueda-hardware-de-datos\/","title":{"rendered":"Alternativas de dise\u00f1o en sistemas de preb\u00fasqueda hardware de datos"},"content":{"rendered":"<h2>Tesis doctoral de <strong> Luis Manuel Ramos Mart\u00ednez <\/strong><\/h2>\n<p>Una soluci\u00f3n interesante al problema de la creciente latencia de acceso a memoria es la preb\u00fasqueda de datos. Gracias a las t\u00e9cnicas de preb\u00fasqueda de datos, la latencia de los accesos puede ser ocultada solap\u00e1ndola con la ejecuci\u00f3n de las instrucciones anteriores. A diferencia de la preb\u00fasqueda software, la preb\u00fasqueda hardware obtiene informaci\u00f3n din\u00e1mica de la ejecuci\u00f3n de la aplicaci\u00f3n, lo que en general permite predecir un mayor n\u00famero de direcciones de acceso a memoria.  aunque las bases de esta preb\u00fasqueda fueron propuestas hace d\u00e9cadas, la investigaci\u00f3n en estos m\u00e9todos contin\u00faa abierta por una serie de razones. En primer lugar su rendimiento depende de los programas y del hardware (procesador y jerarqu\u00eda de memoria), por lo que no existe un m\u00e9todo universal perfecto. Adem\u00e1s ambos elementos cambian continua y significativamente, lo que conlleva la continua revisi\u00f3n de m\u00e9todos de preb\u00fasqueda que, buenos o malos en el pasado, pueden cambiar su car\u00e1cter con las nuevas aplicaciones o el nuevo hardware. Finalmente, la industria s\u00f3lo ha incorporado las t\u00e9cnicas de preb\u00fasqueda m\u00e1s sencillas, no necesariamente las m\u00e1s eficaces, sin duda debido a problemas de coste y dise\u00f1o.  el objetivo de este trabajo ha sido investigar nuevos mecanismos de preb\u00fasqueda hardware de datos que consigan aumentar las prestaciones de los ya conocidos, pero manteniendo siempre un bajo coste de implementaci\u00f3n y extremando la simplicidad en el dise\u00f1o, a fin de hacerlos atractivos para la industria. Para ello, se ha analizado el comportamiento de las instrucciones de acceso a memoria, estableciendo nuevos modelos de regularidad. Tambi\u00e9n se han definido nuevos mecanismos de preb\u00fasqueda y se han evaluado sus rendimientos en un procesador superescalar agresivo y con una jerarqu\u00eda de memoria de alto rendimiento, compar\u00e1ndolos con los actuales. Por otro lado, se han propuesto t\u00e9cnicas para adaptar la agresividad de prebuscadores muy agresivos con el objeto de minimizar las p\u00e9rdidas por aplicaci\u00f3n. Por \u00faltimo, se ha presentado un esquema general de preb\u00fasqueda que permite ser adaptado a distintos objetivos de dise\u00f1o. La evaluaci\u00f3n de esta propuesta se realiz\u00f3 sobre el entorno determinado por el first jilp data prefetching championship (dpc-1), en el que el trabajo obtuvo el best paper award y el tercer puesto en prestaciones.<\/p>\n<p>&nbsp;<\/p>\n<h3>Datos acad\u00e9micos de la tesis doctoral \u00ab<strong>Alternativas de dise\u00f1o en sistemas de preb\u00fasqueda hardware de datos<\/strong>\u00ab<\/h3>\n<ul>\n<li><strong>T\u00edtulo de la tesis:<\/strong>\u00a0 Alternativas de dise\u00f1o en sistemas de preb\u00fasqueda hardware de datos <\/li>\n<li><strong>Autor:<\/strong>\u00a0 Luis Manuel Ramos Mart\u00ednez <\/li>\n<li><strong>Universidad:<\/strong>\u00a0 Zaragoza<\/li>\n<li><strong>Fecha de lectura de la tesis:<\/strong>\u00a0 22\/12\/2009<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n<h3>Direcci\u00f3n y tribunal<\/h3>\n<ul>\n<li><strong>Director de la tesis<\/strong>\n<ul>\n<li>Pablo Enrique Iba\u00f1ez Mar\u00edn<\/li>\n<\/ul>\n<\/li>\n<li><strong>Tribunal<\/strong>\n<ul>\n<li>Presidente del tribunal: clemente Rodriguez lafuente <\/li>\n<li>Francisco Javier Cazorla almeida (vocal)<\/li>\n<li>benjam\u00edn Sahelices fern\u00e1ndez (vocal)<\/li>\n<li>Mar\u00eda Jes\u00fas Garzar\u00e1n arnau (vocal)<\/li>\n<\/ul>\n<\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n","protected":false},"excerpt":{"rendered":"<p>Tesis doctoral de Luis Manuel Ramos Mart\u00ednez Una soluci\u00f3n interesante al problema de la creciente latencia de acceso a memoria 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